Synopsys анонсирует первый в отрасли полный набор IP-ядер для PCIe 6.0

Его наличие позволит разработчикам SoC включать в свои проекты поддержку интерфейса следующего поколения

Компания Synopsys на прошлой неделе представила первый в отрасли полный набор IP-ядер для PCIe 6.0. Он включает в себя контроллер, интерфейс физического уровня (PHY) и средства верификации. Наличие набора позволит разработчикам SoC начать включать в свои проекты поддержку интерфейса следующего поколения.

Основой IP-ядра контроллера Synopsys DesignWare для PCIe 6.0 стало широко используемое и хорошо проверенное на практике ядро DesignWare для PCIe 5.0. Конечно, новое ядро поддерживает новшества, добавленные в PCIe 6.0, в том числе удвоенную скорость передачи данных (до 64 ГТ/с), амплитудно-импульсную модуляцию с четырьмя уровнями (PAM4), режим FLIT и состояние пониженного энергопотребления L0p. Интерфейс физического уровня рассчитан на изготовление по нормам 5 нм. Сочетание «уникальных аналоговых технологий и технологий DSP» позволило уменьшить энергопотребление на 20%. По словам Synopsys, предложенное IP-решение «отвечает растущим требованиям к задержке, пропускной способности и энергоэффективности высокопроизводительных вычислений, систем искусственного интеллекта и систем хранения данных».

Synopsys анонсирует первый в отрасли полный набор IP-ядер для PCIe 6.0

Планируется, что контроллер DesignWare и PHY станут доступны в третьем квартале 2021 года, а IP-ядро для верификации PCIe 6.0 уже доступно.

Напомним, в ноябре прошлого года спецификацию PCIe 6.0 версии 0.7 получили члены ассоциации PCI-SIG, а её окончательная версия должна быть готова в этом году.

23 марта 2021 в 12:34

Автор:

| Источник: Synopsys

Все новости за сегодня

Календарь

март
Пн
Вт
Ср
Чт
Пт
Сб
Вс